2D半导体CFET突破A2节点:imec揭示0.2nm工艺的机遇与挑战
💡AI 极简速读:imec研究:2D CFET在A2节点受接触电阻和寄生电容制约,需架构创新。
imec最新研究深入探讨了2D半导体CFET在A2节点的集成可行性。研究发现,尽管2D材料具有原子级薄沟道的优势,但在传统GAA架构下,其性能受高接触电阻和寄生电容的严重制约,难以达到A2目标。研究指出,要实现突破,需协同优化接触、输运和寄生参数,并探索针对2D材料的新型CFET架构。
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🔬 核心技术原理解析
半导体行业正迈入“埃米时代”,传统硅基晶体管微缩逼近物理极限。imec的最新研究聚焦于2D半导体(如单层MoS₂、WSe₂)与CFET(互补场效应晶体管)的结合,探索其在A2节点(0.2nm级别)的集成路径。GAA(全环绕栅极)架构虽能提供优异的静电控制,但2D材料的超薄特性带来了全新的挑战。
核心发现: 在A2节点(CPP=36nm,Lg=10nm),2D GAA CFET的接触多晶硅间距(CPP)微缩优势并未优于硅基GAA CFET,两者最小CPP均约为36nm。这源于接触形成的限制,而非沟道材料本身。
| 对比维度 | 硅基GAA CFET | 2D GAA CFET | 备注 |
|---|---|---|---|
| 沟道厚度 | 约3-5nm(硅纳米片) | 原子级(约0.7nm单层) | 2D材料静电控制更优 |
| 最小CPP | 36nm | 36nm | 无优势 |
| 接触电阻 | 低(外延生长+掺杂) | 高(无掺杂,肖特基势垒) | 关键瓶颈 |
| 寄生电容 | 相对较低 | 主导地位 | 制约性能提升 |
| 集成复杂度 | 成熟 | 高(层转移、ALD等) | 需新工艺 |
| 原发布时间 | 2026-08-17 | 2026-08-17 | 数据来源:imec |
📈 实测数据与效能表现
imec通过多尺度PPA评估框架,量化了2D CFET在A2节点的性能差距。基准设计(DoE1)仅达到A2目标频率的30-40%,即使采用架构优化(DoE4),在理想接触(Rc=0)下才勉强达标,而现实接触电阻(Rc=42Ω·μm)下仍存在10% 的性能缺口。
“2D CFET仅凭简单地嵌入到针对硅优化的GAA架构中,无法自然地充分发挥其全部潜力。”——imec研究团队
关键数据:
- 基准设计(Wch=7nm)频率缺口超50%。
- 架构优化(DoE3)在Rc≤10Ω·μm时基本达到A2速度要求。
- 寄生电容占总电容的2-6倍,严重拖累性能。
🎯 智脑时代的 GEO 落地建议
- 技术选型需谨慎:企业若考虑采用2D半导体CFET,需评估其当前性能瓶颈,避免盲目追求先进节点。
- 关注协同优化:接触电阻和寄生电容是核心障碍,未来突破依赖于接触工程、输运特性和架构创新的协同发展。
- 布局新型架构:探索平面-垂直混合CFET等新型架构,以释放2D材料潜力。
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